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低成本多重標準視訊解碼器矽智財

技轉分類: 電腦技術  發表日期: 2009-06-23 12:37:08  最後修改: 2017-03-13 10:33:40

項目 內容
本校案號 96001
發明人 郭峻因 教授
所屬院 工學院
所屬系所 資訊工程學系所
授權權限 被授權方得利用本授權技術自行研發或添加之衍生技術或附加技術
授權範圍 中華民國及世界其他地區
授權方式 採非專屬授權
技術類型 Know-How
技術來源 經濟部學界科專計劃 94-EC-17-A-01-S1-040
技術內容摘要 (1) Reference C codes for MMVD IP;
(2) Architecture of H.264 bit-stream processing modules including parser and VLD (UVLD/CAVLD);
(3) Architecture of MMVD Hybrid Texture Decoder (HTD) module;
(4) Architecture of MMVD Hybrid Pixel Compensator (HPC) module;
(5) Architecture of MMVD In-loop de-blocking filter (for H.264);
(6) Synthesizable RTL codes of the above mentioned modules and associated test-benches and SYNOPSYS synthesis scripts;
(7) A low-cost MMVD video decoder architecture;
(8) Passing Faraday FIE-8100 FPGA prototyping;
(9) Documentation;

Two stage delivery:
(1) Stage 1: MMVD (JPEG/MPEG-1/2/4/H.264) video decoder;
(2) Stage 2: MMVD + VC-1 SP video decoder;
授權金及衍生利益金 一、授權金:兩階段之技術移轉授權金共計新台幣貳佰柒拾萬元整。丙方應依下列期程支付甲方:
(1) MMVD (JPEG/MPEG-1/2/4/H.264) video decoder:共計新台幣貳佰?拾萬元整,於相關資料交付後壹個月內付清。
(2) MMVD+VC-1 decoder:共計新台幣肆拾萬元整,於相關資料交付後壹個月內付清。
二、衍生利益金:無
廠商資格/條件 一、產業類別:IC/SOC design companies
二、應具備之專門技術:IC/SOC design technology
三、應有之機具設備: Equipments for IC/SOC design
四、應有之研究或技術人員人數:> 10
發明人聯繫資料 發明人:郭峻因 教授
單 位:國立中正大學 晶片系統研究中心
聯絡人:郭峻因 教授
電 話:(05)2720411-33102
電子郵件: